Preguntas etiquetadas con vhdl

El lenguaje de descripción de hardware VHDL (VHSIC (circuito integrado de muy alta velocidad)) es un lenguaje de descripción de hardware utilizado en la automatización de diseño electrónico para describir y diseñar sistemas digitales, como arreglos de puertas programables en campo y circuitos integrados.

Proyecto para aprender VHDL

Soy un estudiante de EE y puedo escribir programas [al menos simples] en más idiomas de los que tengo en los dedos. Acabo de empezar a aprender VHDL y me preguntaba qué sería un buen proyecto para conocer realmente el idioma y las herramientas relevantes. Tengo problemas para encontrar uno …

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¿Cuál es la diferencia entre prueba y verificación?

Todos los libros de texto que he visto explican en gran medida el hecho de que las pruebas y la verificación son dos conceptos diferentes. Sin embargo, ninguno de ellos proporciona una distinción clara (o lo suficientemente clara para mí). Para proporcionar algo de contexto, estoy interesado en la verificación …

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VHDL: nomenclatura e interpretación de arquitectura

Nota: Estoy usando el ISE de Xilinx y tengo una placa FPGA para trabajar (con interruptores y luces, etc.), y hasta ahora he pirateado algunos proyectos simples. Al mismo tiempo, estoy leyendo varios tutoriales para construir una base para lo que estoy haciendo. He visto varias entidades y sus arquitecturas …

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¿Cómo funcionan los transistores BJT en estado saturado?

Esto es lo que sé sobre NPN BJT (Transistores de unión bipolar): La corriente del emisor base se amplifica HFE veces en Collector-Emitter, de modo que Ice = Ibe * HFE Vbees el voltaje entre el emisor base y, como cualquier diodo, generalmente es de alrededor de 0,65V. Sin Vecembargo, …

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¿Qué me haría elegir Verilog o VHDL sobre el diseño esquemático en CPLD o FPGA?

No tengo absolutamente ninguna experiencia en lógica programable, utilizo principalmente microcontroladores en mis proyectos, pero recientemente necesitaba trabajar con video y el microcontrolador es demasiado lento para lo que necesitaba, así que comencé a jugar con CPLD. Pude obtener buenos resultados con el CPLD solo usando un diseño esquemático, pero …

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Cómo dividir 50MHz a 2Hz en VHDL en Xilinx FPGA

Tengo una placa Xilinx FPGA, con un cristal de 50MHz. Necesito dividir eso a 2Hz en VHDL. ¿Cómo hago esto?

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Diseño de firmware FPGA: ¿Qué tan grande es demasiado grande?

Tengo una transformación de procesamiento de señal particularmente grande que necesita ser portada de matlab a VHDL. Definitivamente requiere algún tipo de intercambio de recursos. Un poco de cálculo me dio lo siguiente: 512 ffts de 64 puntos 41210 operaciones de adición múltiple Teniendo en cuenta que el FPGA Virtex …

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Cheap FPGA dev board [cerrado]

Cerrado. Esta pregunta está fuera de tema . Actualmente no está aceptando respuestas. ¿Quieres mejorar esta pregunta? Actualice la pregunta para que sea sobre el tema para el intercambio de pila de ingeniería eléctrica. Cerrado hace 4 años . Quiero comenzar con FPGA, pero nunca antes había trabajado. Quiero un …

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recomendaciones de libros sobre FPGA [cerrado]

Cerrado. Esta pregunta está fuera de tema . Actualmente no está aceptando respuestas. ¿Quieres mejorar esta pregunta? Actualice la pregunta para que sea sobre el tema para el intercambio de pila de ingeniería eléctrica. Cerrado hace 2 años . ¿Qué títulos de libros recomendaría para comenzar con FPGA y VHDL? …

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¿Cómo depuro las señales rojas en ModelSIM?

Tengo que diseñar una máquina de estados usando solo compuertas NAND para la parte combinatoria y flip flops D para la lógica secuencial. Todo debería funcionar a un reloj de 1ghz / 53. Ahora, antes de que me asaltes con "no haremos tu tarea por ti", déjame decirte que descarté …

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¿Cómo puedo especificar señales de "no me importa" en VHDL?

En los cursos de diseño lógico, todos aprendimos que es posible minimizar una función lógica, por ejemplo, utilizando un mapa de Karnaugh o el algoritmo Quine-McCluskey . También aprendimos que los valores de "No me importa" aumentan el potencial de minimización. Por ejemplo, tome un archivo de registro. Las señales …

11 vhdl synthesis optimization

¿Cómo identificar las áreas de un diseño FPGA que utilizan la mayoría de los recursos y el área?

Estoy trabajando en un gran diseño FPGA, y estoy muy cerca de los límites de recursos del FPGA que estoy usando actualmente, el Xilinx LX16 en el paquete CSG225. El diseño también está casi completo, sin embargo, por el momento ya no cabe en el FPGA. Puedo apagar las piezas …

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Diferencia entre If-else y Case en VHDL

Quiero entender cómo se sintetizan diferentes construcciones en el código VHDL en RTL. ¿Alguien puede decirme la diferencia entre la construcción If-Else y las construcciones de declaración de caso de un proceso en VHDL en términos de cómo la herramienta de síntesis inferencia el código en el circuito RTL? Considere …

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¿Cuándo es mejor usar representaciones VECTOR vs INTEGER?

En el hilo de comentarios sobre una respuesta a esta pregunta: Resultados incorrectos en la entidad VHDL se dijo: "Con los enteros no tienes control o acceso a la representación lógica interna en el FPGA, mientras que SLV te permite hacer trucos como utilizar la cadena de transporte de manera …

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¿Usas VHDL hoy en día?

Soy un estudiante de Ingeniería Eléctrica y estoy estudiando el lenguaje de descripción de hardware conocido como VHDL. Lo busqué en Google buscando un IDE (estoy en una Mac), pero este lenguaje parece bastante muerto. Así que aquí está mi pregunta: en mi futuro trabajo como ingeniero eléctrico, ¿me será …

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