Ingenieria Eléctrica

Preguntas y respuestas para profesionales de la electrónica y la ingeniería eléctrica, estudiantes y entusiastas.



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Desgaste nivelado en EEPROM de un microcontrolador
Por ejemplo: la hoja de datos para ATtiny2313 (como la mayoría de las hojas de datos de Atmel AVR) establece: 128 bytes de resistencia EEPROM programable en el sistema: 100,000 ciclos de escritura / borrado Imagine que un programa solo requiere dos bytes para almacenar alguna configuración, los otros 126 …

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PCB de tierra y planos de potencia
Estoy designando una PCB de 4 capas con la siguiente pila: Señal superior, plano de tierra, plano de alimentación, señal inferior. Esta es la primera PCB que hago así, que incluye un SMPS ruidoso con una frecuencia de conmutación de 600KHz, así como un módulo de 32MHz uC y un …


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Comunicación entre mitades de maletín
Estoy construyendo un pequeño dispositivo portátil en un maletín. Imagina que los cables verdes no están allí. La mitad de la pantalla LCD se encuentra algo más profunda en su estuche que la parte del teclado. Por ahora, probando y programando, estoy usando cuatro cables (2x I2C, tierra, 5V) para …


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¿Protege el flash AVR de la lectura a través de ISP?
Estoy tratando de proteger todo el flash de la lectura a través de ISP. Cuenta con gestor de arranque, capaz de programar la sección de aplicación. Establecer el byte de bloqueo en: LB1/LB2 no permitirá que el usuario use el gestor de arranque para cargar nuevo firmware. BLB12/BLB11y BLB01&BLB02no evitaré …
15 avr  atmega  protection 




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¿Para "rellenar el suelo" o no para "rellenar el suelo"?
He estado leyendo sobre los problemas de EMI en Ingeniería de compatibilidad electromagnética por Henry Ott. (maravilloso libro por cierto). Uno de los temas "Diseño y apilamiento de PCB" (también conocido como Ch 16) hay una sección sobre relleno de tierra (16.3.6). Básicamente lo que dice, que para minimizar el …
15 pcb  emc  groundloops 



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¿Pueden los FPGA modificar dinámicamente su lógica?
Teóricamente sería posible que un FPGA escribiera una imagen de configuración en una memoria externa y cargara la imagen de configuración desde la memoria para reconfigurarse. Esta sería una reconfiguración "no dinámica". ¿Los FPGA tienen la capacidad de volver a cablear su tejido lógico dinámicamente? De hecho, si bien los …
15 fpga 

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