Estoy familiarizado (alto nivel) con el funcionamiento de la memoria direccionable de contenido ternario, pero sigo confundido sobre cómo TCAM se relaciona con los ASIC y cuándo estos componentes posiblemente también se combinen con la CPU para un mayor rendimiento de conmutación ... (particularmente cuando los proveedores suelen comercializar el uso de silicio comercial / personalizado, o ASIC personalizados para nuevos productos y características, entonces parece confuso) .
Estoy familiarizado con Cisco IOS, por ejemplo, con la capacidad de particionar más espacio para el rendimiento de TCAM para funciones como qos, acl y búsquedas de rutas. También entiendo que características como NAT todavía dependerán del procesamiento de la CPU, sin embargo, estoy luchando específicamente con;
- ¿Forma parte la TCAM de la misma arquitectura de hardware, es decir, interna o externa al ASIC?
- ¿Las TCAM son escalables (por ejemplo, ¿pueden los fabricantes seguir agregando TCAM a una plataforma para un mayor rendimiento y características personalizadas) o hay un límite basado en cosas como el consumo de energía?
- ¿Los ciclos TCAM y los ASIC funcionan en paralelo con la CPU para funciones como NAT o solo debería considerarlos como elementos independientes?